Altera Low Latency 40-Gbps Ethernet MAC and PHY MegaCore Instrukcja Użytkownika Strona 179

  • Pobierz
  • Dodaj do moich podręczników
  • Drukuj
  • Strona
    / 196
  • Spis treści
  • BOOKMARKI
  • Oceniono. / 5. Na podstawie oceny klientów
Przeglądanie stron 178
Word Addr Bit R/W Name Description
0x4D5
27:24 R RXEQ CTLE Setting Most recent ctle_rc setting sent to the reconfig
bundle during RX equalization.
29:28 R RXEQ CTLE Mode Most recent ctle_mode setting sent to the reconfig
bundle during RX equalization.
31:30 R RXEQ DFE Mode Most recent dfe_mode setting sent tothe reconfig
bundle during RX equalization.
B-20
10GBASE-KR PHY Register Definitions
UG-01172
2015.05.04
Altera Corporation
Arria 10 10GBASE-KR Registers
Send Feedback
Przeglądanie stron 178
1 2 ... 174 175 176 177 178 179 180 181 182 183 184 ... 195 196

Komentarze do niniejszej Instrukcji

Brak uwag